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    電動汽車系統中通過隔離降低EMI的三種方案

    時間:2021-03-16 08:33:10來源:網絡 作者: 點擊:
    節能環保已成為今天電源解決方案的發展主旋律。電源系統正面臨前所未有的挑戰:環境的惡化迫使人們不得不考慮采用更加清潔的替代能源;電子設備的發展也亟需提升現有電源系

    節能環保已成為今天電源解決方案的發展主旋律。電源系統正面臨前所未有的挑戰:環境的惡化迫使人們不得不考慮采用更加清潔的替代能源;電子設備的發展也亟需提升現有電源系統的轉換效率。通過提高電源系統轉換效率,優化不同負載條件下的功耗以及采用新型綠色能源,可實現節能環保的目標。

      空間受限的應用以及散熱的挑戰

      讓系統設計師煩擾的一個常見問題是應采用單級轉換還是兩級或者更多級轉換,比方說從48V到1.xV,是  轉換,還是從48V到12V中間總線架構,然后再利用負載點(POL)轉換器從12V轉換到1.xV。具體采用何種架構取決于很多因素,包括根據系統類型、采用的設計方法以及其他因素來決定。然而不管采用哪種架構,電壓不斷下降的同時對電流有更高需求的應用,持續推動著很多這類大功率系統的開發,并推動著對于電源IC技術的不斷改進?傮w來說,在對電源轉換效率產生  影響的前提下允許采用更高的開關頻率,還可以依靠降低開關損耗和導通損耗來提高電源效率性能。分立式電源設計是將傳統的電源模塊和分立元件一起放置在一塊印刷電路板上,由于外形尺寸的影響而導致電氣性能和熱性能均受到限制。因此,關鍵是提供一個完全集成并提高電氣和散熱性能的電源解決方案,同時又能給工程師提供一個易于使用和靈活編程的緊湊型方案。

      Altera旗下Enpirion品牌的PowerSoC采用獨特的MEMS電感集成技術和EDMOS開關管集成技術,在實現高功率密度和更高效率性能的目標上大大前進了一步。其能夠滿足高性能、大功率空間受限電源設計面臨的巨大挑戰。

      其實,大功率POL穩壓器是空間受限電源設計的一個很好的例子。這種類型的電源在大型系統板上一般放在非?拷⑻幚砥、FPGA或者ASIC的地方,為這些器件提供全部所必需的功率。大型數字器件常常需要范圍為幾安培至100安培以上的電流。大型系統板常常需要幾個這樣的POL電源,因此為這些電源設計中的每一個分配空間帶來了挑戰。除此之外,系統板的背面常常是高度受限的,一般不適合電源設計。分立電源轉換器一般會利用系統板的兩面實現緊湊型設計,而傳統電源模塊設計由于其高度太高,將僅限于系統板正面。Altera新推出的一系列電源集成方案都實現更低的方案尺寸和器件高度,非常適合空間受限的大型功率應用,例如可提供連續輸出電流30A的數字電源方案EM1130。該產品集成電感、開關MOSFET、控制器和補償回路,整體器件尺寸只有11mm×17mm,高度僅有5mm,整個方案整體的占位面積小于360mm2,并有進一步縮小方案尺寸的潛能。

      圖1全集成的30A數字電源EM1130以及方案占位圖

      另外一個引人注目的用于POLDC/DC轉換的IC是EC7401。該器件是一個4相同步降壓型開關控制器,具有跟蹤功能,用于驅動外部互補功率MOSFET。其具有MOSFETVDS檢測的恒定功率,電流模式架構消除了對電流檢測電阻的需求,降低了成本并提高了工作效率。讓多個PowertrainET4040以異相工作,  大限度地降低了由輸入電容器ESR引起的功率損耗和噪聲。EC7401+ET4040方案還極大地降低了輸入和輸出電源上的峰值輻射和傳導噪聲。這使符合國際EMI標準更加容易,100%占空比能力提供了低壓差工作性能。

      由于在一個給定機箱內的空間和冷卻受限,以及需要正確的電源跟蹤以改善系統可靠性等多種限制因素,用于大功率的POLDC/DC轉換器的設計工程師面臨很多挑戰。盡管市場上產品設計周期在日益縮短,因為Altera的PowerSoC系列產品易于使用,所以可以縮短產品從開發至上市的時間,并  地降低了設計難度。

      需要滿足更嚴苛的電氣性能

      電氣系統節能在  的勢頭正在增強,就產生和消耗而言,成本節省太具有吸引力了。迎接這一挑戰的是電源管理IC供應商,他們正在采用新的設計方法,以在其產品中對數十安培負載電流實現高效率轉換。同時,他們還在IC置于備用或者停機模式的同時實現更低的靜態電流。

      設計工程師需要應對的挑戰是,滿足所有系統內核中不斷增加的高性能DSP和ASIC電氣性能要求。主要性能問題包括電壓穩壓、電流瞬態響應和噪聲。

      穩壓和電流瞬態響應密切相關。為了在解決方案尺寸越來越小且功耗越來越低的情況下獲得更高的性能,要使用所需電壓也不斷降低的更小晶體管工藝來制造數字半導體,F在低于1V的內核電壓要求將成為標準的電壓要求。除了低壓以外,對電壓容差的要求也越來越高。目前常用的標準是:線路(輸入電壓變化)、負載(負載電流微小變化)、時間、溫度和電流瞬變等造成的總電壓容差不超過3%。這樣,電源設計人員就只有30mV的電壓空間來滿足所有的數字系統要求。線路、負載、時間和溫度等DC參數還要占用大約一半(15mV)的容差預算。剩余的15mV則用于處理計算或數據傳輸負載帶來的突發電流變化(1個至3個時鐘周期)。<<容~源~電~子~網~版權聲明:本站內容部分來源于網絡,如侵犯到你的權利請及時與我們聯系更正,聯系QQ:316520686。

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